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Systemverilog
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Systemverilog
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// tests_fp.vh
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// Written: Katherine Parry 2022
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// Modified:
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// Purpose: List of floating-point tests to apply
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// A component of the Wally configurable RISC-V project.
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// Copyright (C) 2021-3 Harvey Mudd College & Oklahoma State University
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// SPDX-License-Identifier: Apache-2.0 WITH SHL-2.1
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//
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// Licensed under the Solderpad Hardware License v 2.1 (the “License”); you may not use this file
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// except in compliance with the License, or, at your option, the Apache License version 2.0. You
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// may obtain a copy of the License at
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//
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// https://solderpad.org/licenses/SHL-2.1/
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//
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// Unless required by applicable law or agreed to in writing, any work distributed under the
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|
// License is distributed on an “AS IS” BASIS, WITHOUT WARRANTIES OR CONDITIONS OF ANY KIND,
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// either express or implied. See the License for the specific language governing permissions
|
|
// and limitations under the License.
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`define PATH "../../tests/fp/vectors/"
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`define ADD_OPCTRL 3'b110
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`define LE_OPCTRL 3'b011
|
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`define LT_OPCTRL 3'b001
|
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`define EQ_OPCTRL 3'b010
|
|
`define TO_UI_OPCTRL 3'b000
|
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`define TO_I_OPCTRL 3'b001
|
|
`define TO_UL_OPCTRL 3'b010
|
|
`define TO_L_OPCTRL 3'b011
|
|
`define FROM_UI_OPCTRL 3'b100
|
|
`define FROM_I_OPCTRL 3'b101
|
|
`define FROM_UL_OPCTRL 3'b110
|
|
`define FROM_L_OPCTRL 3'b111
|
|
`define RNE 3'b000
|
|
`define RZ 3'b001
|
|
`define RU 3'b011
|
|
`define RD 3'b010
|
|
`define RNM 3'b100
|
|
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|
|
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|
|
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|
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|
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string f16rv32cvtint[] = '{
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"f32_to_f128_rz.tv",
|
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"f32_to_f128_ru.tv",
|
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"f32_to_f128_rd.tv",
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|
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|
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string f64add[] = '{
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"f64_add_rz.tv",
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string f128add[] = '{
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"f128_add_rz.tv",
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|
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|
|
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string f128sub[] = '{
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string f16mul[] = '{
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|
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string f32mul[] = '{
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string f64mul[] = '{
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"f64_mul_rz.tv",
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|
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"f64_mul_rnm.tv"
|
|
};
|
|
|
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string f128mul[] = '{
|
|
"f128_mul_rne.tv",
|
|
"f128_mul_rz.tv",
|
|
"f128_mul_ru.tv",
|
|
"f128_mul_rd.tv",
|
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"f128_mul_rnm.tv"
|
|
};
|
|
|
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string f16div[] = '{
|
|
"f16_div_rne.tv",
|
|
"f16_div_rz.tv",
|
|
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|
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|
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|
|
};
|
|
|
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string f32div[] = '{
|
|
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|
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|
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|
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|
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|
|
};
|
|
|
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string f64div[] = '{
|
|
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|
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|
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|
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|
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|
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|
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string f128div[] = '{
|
|
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|
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|
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|
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|
|
|
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string f16sqrt[] = '{
|
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|
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|
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|
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string f32sqrt[] = '{
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|
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|
|
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|
|
|
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string f64sqrt[] = '{
|
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|
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|
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|
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|
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string f128sqrt[] = '{
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|
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|
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|
|
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|
|
|
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string f16cmp[] = '{
|
|
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|
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|
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|
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|
|
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|
|
|
|
string f32cmp[] = '{
|
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|
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};
|
|
|
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string f64cmp[] = '{
|
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|
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|
|
|
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string f128cmp[] = '{
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|
|
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|
|
|
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string f16fma[] = '{
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|
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|
|
|
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string f32fma[] = '{
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|
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|
|
|
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string f64fma[] = '{
|
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string f128fma[] = '{
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|
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|
|
|